A Alphawave, designer de chips e componentes com silício, anunciou parceria com a empresa Keysight, fabricante de medidores e componentes para testes, para desenvolvimento do PCIe 6.0 . O resultado é um projeto para testar a PCIe 6.0, com uma interface física para testar a taxa de transferência do slot, que alcançou 64 GT/s (Gigatransfer por segundo).
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Com a implementação do silício do novo Alphawave Semi PCIe 6.0 64 GT/s Flow Control Unit (FLIT) e o Protocol Exerciser da Keysight foi possível estabelecer um link CXL 2.0 (Compute Express Link) com os 64 GT/s de velocidade, mas ainda há alguns desafios para superar.
O PCIe 6.0 avança da tecnologia NRZ (Non-Return-to-Zero) de dois níveis, que é uma codificação de sinal, para PAM4 de quatro níveis, que é uma técnica de modulação de dados. Isso gera um aumento de desempenho ao mesmo tempo que traz desafios na integridade do sinal. Para contornar isso, foi necessário implementar FEC (Forward Error Correction) via FLIT, que permite uma maior taxa de erros de bits com uma quantidade aceitável de perdas causadas pela alta velocidade.
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"O PCIe 6.0 marca a evolução da tecnologia ubíqua de sinalização de NRZ de dois níveis para PAM4 de quatro níveis. Embora essa transição introduza desafios de integridade de sinal e novos protocolos para garantir a essencial compatibilidade retroativa, ela aprimora a capacidade de futuro da tecnologia por meio da implementação de FEC via FLIT. O FEC permite uma maior tolerância à taxa de erro de bits (BER) enquanto ainda entrega uma perda de pacotes aceitável. Essa colaboração resultou na demonstração bem-sucedida de transações no modo FLIT (solicitações/conclusões) de FLITs de carga na implementação de silício do subsistema PCIe 6.0 de 64 GT/s", detalhou a Alphawave.
A empresa ainda destaca que o próximo passo para o Alphawave Semi PCIe 6.0 é expandir o suporte para CXL 3.0 usando um controlador PCIe e CXL, aumentando a coerência da memória, que ainda é um grande desafio, para nível de data center.
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